Senior FPGA / SystemVerilog Entwicklungsingenieur
Eningen unter Achalm
veröffentlicht
- Sie realisieren Hochgeschwindigkeits-FPGA Designs für PCIe Gen. 5 und Gen. 6 Anwendungen mit seriellen Datenraten bis zu 64GBit/s. Das Spannende daran ist, Sie entwickeln hier an der Grenze des technologisch Machbaren.
- Sie arbeiten an einem echten Produkt – von der Spezifikation bis hin zur Serienproduktion.
- Mit einem sehr guten Systemverständnis sind Sie in der Lage, auch komplexe Spezifikationen selbstständig in Designs umzusetzen.
- Dabei steht Ihnen ein erfahrenes Team von FPGA-Entwicklungsingenieuren zur Seite.
Voraussetzungen
- Sie haben ein abgeschlossenes Studium der Fachrichtung Elektrotechnik, Informatik, Physik oder einen vergleichbaren Abschluss.
- Sie besitzen mehrjährige Erfahrung in der Entwicklung von digitalen Schaltungen für FPGAs oder ASICs.
- Sie besitzen fundierte Kenntnisse im digitalen Schaltungsdesign mit mehreren Taktdomänen.
- Sie haben gute Kenntnisse in mindestens einer Hardwarebeschreibungssprache (SystemVerilog oder VHDL).
- Sie kennen die aktuellen FPGA Architekturen und die entsprechende Design Software der Hersteller Xilinx und/oder Intel.
- Sie haben Kenntnisse in mindestens einer Skriptsprache, vorzugsweise Python oder TCL.
- Sie verfügen idealerweise über Erfahrungen mit Kommunikationsprotokollen wie PCIe, CXL, SAS oder Ethernet.
- Sie weisen einen selbstständigen Arbeitsstil auf, haben analytische Fähigkeiten und besitzen insbesondere die Fähigkeit zur Abstraktion
- Abgerundet wird Ihr Profil durch verhandlungssichere Deutsch- und Englischkenntnisse.
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| Anzeigenart | Stellenangebot |
|---|---|
| Arbeitszeit | Vollzeit |
| Vertragsart | Festanstellung |
| Berufliche Praxis | mit Berufserfahrung |
| Aus- und Weiterbildung | Abschluss Hochschule / Berufsakademie / Duales Studium |
| Berufskategorie | Produktion, Forschung und Entwicklung / Forschung und Entwicklung |
| Arbeitsort |
Arbachtalstraße 5,
72800
Eningen unter Achalm
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Arbeitgeber
VIAVI Solutions GmbH
Kontakt für Bewerbung
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| Benefits |
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